Análise Estática de Tempo
A Análise Estática de Tempo (STA) é um método não-simulacional para verificar se os circuitos digitais atendem às restrições de tempo (frequências de clock, tempos de setup/hold, atrasos de propagação). Introduzida sistematicamente por Bhatnagar et al. na década de 1990, a STA calcula os atrasos de caminho no pior e no melhor caso, analisando os caminhos lógicos sem simular vetores. A STA é essencial para o projeto VLSI moderno, permitindo um fechamento de tempo rápido antes da fabricação do silício e identificando caminhos críticos para otimização.
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Fontes
- Bhatnagar, H., & Bhatnagar, R. (1995). Static timing analysis: A primer. In VLSI Handbook (pp. 1-25). CRC Press. link ↗
- Shen, A., Ghosh, A., Madden, S. H., & Sorkin, F. (2003). Fast algorithms for static timing analysis. In Proc. ICCAD (pp. 126-131). IEEE. link ↗
- Berkelaar, M., Duffack, M., Flach, G., & Hartoog, R. (2007). OpenTimer: An open-source static timing analyzer. Proc. International Symposium on Circuits and Systems. link ↗
Como citar esta página
ScholarGate. (2026, June 3). Static Timing Analysis for Digital Circuit Verification. ScholarGate. https://scholargate.app/pt/electrical-engineering/static-timing-analysis
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