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Process / pipelineControl systems, signal processing

위상 고정 루프

위상 고정 루프(PLL)는 출력 발진기를 입력 신호의 위상 및 주파수와 일치하도록 동기화하는 피드백 제어 시스템입니다. 1966년 Gardner에 의해 소개된 PLL은 통신, 레이더, 클럭 분배 및 전력 시스템에서 보편적으로 사용됩니다. PLL은 위상 오차를 최소화하기 위해 발진기 주파수를 지속적으로 조정하여 잠금 상태를 달성합니다. PLL은 현대 전자 시스템의 기본입니다.

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출처

  1. Gardner, F. M. (1966). Phaselock Techniques. Wiley & Sons. link ↗
  2. Wolaver, D. H. (1991). Phase-Locked-Loop Circuit Design. Prentice Hall. link ↗
  3. Best, R. E. (2007). Phase-Locked Loops: Design, Simulation, and Applications (5th ed.). McGraw-Hill. link ↗

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ScholarGate. (2026, June 3). Phase-Locked Loop for Frequency Synchronization and Clock Recovery. ScholarGate. https://scholargate.app/ko/electrical-engineering/phase-locked-loop

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